任意のPID制御出力値設定可否について

2自由度型高機能PID制御(M_2PIDH_、M_2PIDH_T)のFBプロパティで、センサエラー発生時のMV出力の方法を定義することができます。＜例＞センサエラー発生時にMV出力を0にする場合 FBプロパティページの｢出力｣→｢M

3位置ON／OFF FBへの不感帯設定に

3位置ON／OFFのヒステリシスHS1が不感帯に相当します。図1

出力の急変を防ぐ方法について

変化率リミッタ命令(P_VLIMIT1)を使用して、変化速度制限をかけることができます。図1

システムリソースのアドレス変更可否につい

Ver.1.19V以降で変更できます。｢プロジェクトパラメータ設定｣の｢システムリソース｣画面で、｢ファイルレジスタ：ZR｣、｢タイマ：T」、｢内部リレー：M｣の先頭アドレスを変更できます。図1

MELSECNET/HリモートI/O局の

7段まで増設可能です。

QJ72LP25-25の複数枚装着可否に

2枚装着することはできません。 QJ72LP25-25は、1枚のみ装着可能です。（装着位置は、基本ベースユニットのCPUスロットです。）

ファイルレジスタのトラッキング設定要否に

設定不要です。 PX Developerでコンパイルを行うことで、自動的にトラッキングブロックNo.64に割り付けられます。ユーザプログラムにてシステムリソース以外のデバイスを使用する場合は、トラッキング項目として設定が必要です。

待機系ダウン時のERR端子について

制御系の電源ユニットのERR端子はOFFしません。待機系の電源ユニットのERR端子はOFFします。

電源二重化時の定格出力電流について

ＤＣ５Ｖ定格出力電流は、２倍になりません。二重化電源ユニット１台分のＤＣ５Ｖ定格出力電流を（８．５Ａ）を超えないようにしてください。二重化電源ユニットは、２台並列で運転すると負荷電流を半分ずつ負担して運転します。一方の二重化

基本ベースユニットに装着可能なユニットに

Qシリーズ二重化CPUが装着されている基本ベースユニットに装着できるユニットは、以下となります。図1

よくあるご質問
(FAQ)

Q: 3位置ON／OFF FBへの不感帯設定に

3位置ON／OFFのヒステリシスHS1が不感帯に相当します。 図1

Q: 出力の急変を防ぐ方法について

変化率リミッタ命令(P_VLIMIT1)を使用して、変化速度制限をかけることができます。 図1

Q: システムリソースのアドレス変更可否につい

Ver.1.19V以降で変更できます。 ｢プロジェクトパラメータ設定｣の｢システムリソース｣画面で、｢ファイルレジスタ：ZR｣、｢タイマ：T」、｢内部リレー：M｣の先頭アドレスを変更できます。 図1

Q: MELSECNET/HリモートI/O局の

7段まで増設可能です。

Q: QJ72LP25-25の複数枚装着可否に

2枚装着することはできません。 QJ72LP25-25は、1枚のみ装着可能です。 （装着位置は、基本ベースユニットのCPUスロットです。）

Q: 待機系ダウン時のERR端子について

制御系の電源ユニットのERR端子はOFFしません。 待機系の電源ユニットのERR端子はOFFします。

Q: 電源二重化時の定格出力電流について

ＤＣ５Ｖ定格出力電流は、２倍になりません。 二重化電源ユニット１台分のＤＣ５Ｖ定格出力電流を（８．５Ａ）を超えないようにしてください。 二重化電源ユニットは、２台並列で運転すると負荷電流を半分ずつ負担して運転します。 一方の二重化

Q: 基本ベースユニットに装着可能なユニットに

Qシリーズ二重化CPUが装着されている基本ベースユニットに装着できるユニットは、以下となります。 図1

よくあるご質問(FAQ)製品について

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任意のPID制御出力値設定可否について

2自由度型高機能PID制御(M_2PIDH_、M_2PIDH_T)のFBプロパティで、センサエラー発生時のMV出力の方法を定義することができます。＜例＞センサエラー発生時にMV出力を0にする場合 FBプロパティページの｢出力｣→｢MV出力選択｣で・｢センサアラーム発生時のMV出力選択｣で、｢プリセットM... 詳細表示
- FAQ番号：14233
- 公開日時：2012/03/28 21:15
- カテゴリー： PX Developer
3位置ON／OFF　FBへの不感帯設定について

3位置ON／OFFのヒステリシスHS1が不感帯に相当します。図1 詳細表示
- FAQ番号：14232
- 公開日時：2012/03/28 21:15
- カテゴリー： PX Developer
出力の急変を防ぐ方法について

変化率リミッタ命令(P_VLIMIT1)を使用して、変化速度制限をかけることができます。図1 詳細表示
- FAQ番号：14231
- 公開日時：2012/03/28 21:15
- カテゴリー： PX Developer
システムリソースのアドレス変更可否について

Ver.1.19V以降で変更できます。｢プロジェクトパラメータ設定｣の｢システムリソース｣画面で、｢ファイルレジスタ：ZR｣、｢タイマ：T」、｢内部リレー：M｣の先頭アドレスを変更できます。図1 詳細表示
- FAQ番号：14227
- 公開日時：2012/03/28 21:15
- カテゴリー： PX Developer
MELSECNET/HリモートI/O局の増設ベースユニット接続段数について

7段まで増設可能です。詳細表示
- FAQ番号：14192
- 公開日時：2012/03/28 21:15
- カテゴリー： MELSECNET/H
QJ72LP25-25の複数枚装着可否について

2枚装着することはできません。 QJ72LP25-25は、1枚のみ装着可能です。（装着位置は、基本ベースユニットのCPUスロットです。）詳細表示
- FAQ番号：14190
- 公開日時：2012/03/28 21:15
- カテゴリー： MELSECNET/H
ファイルレジスタのトラッキング設定要否について

設定不要です。 PX Developerでコンパイルを行うことで、自動的にトラッキングブロックNo.64に割り付けられます。ユーザプログラムにてシステムリソース以外のデバイスを使用する場合は、トラッキング項目として設定が必要です。詳細表示
- FAQ番号：14182
- 公開日時：2012/03/28 21:15
- カテゴリー： PX Developer
待機系ダウン時のERR端子について

制御系の電源ユニットのERR端子はOFFしません。待機系の電源ユニットのERR端子はOFFします。詳細表示
- FAQ番号：14178
- 公開日時：2012/03/28 21:15
- カテゴリー：二重化CPU
電源二重化時の定格出力電流について

ＤＣ５Ｖ定格出力電流は、２倍になりません。二重化電源ユニット１台分のＤＣ５Ｖ定格出力電流を（８．５Ａ）を超えないようにしてください。二重化電源ユニットは、２台並列で運転すると負荷電流を半分ずつ負担して運転します。一方の二重化電源ユニットが故障した場合には、他方の二重化電源ユニットのみで運転します。詳細表示
- FAQ番号：14172
- 公開日時：2012/03/28 21:15
- カテゴリー：電源
基本ベースユニットに装着可能なユニットについて

Qシリーズ二重化CPUが装着されている基本ベースユニットに装着できるユニットは、以下となります。図1 詳細表示
- FAQ番号：14169
- 公開日時：2012/03/28 21:15
- カテゴリー：二重化CPU